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0
+1
Di
Tb
t
-1
+1
Cj
Tc
t
-1
M
+1
t
-1
Mk
Dcalage
Tc
REG2
Chargement
Tb
Fig. 1
C3 C2 C1 C0
Echantillonnage
Tb
S j M j i Ci
i 0
Mi
t
-1
+1
{C0 C1 C2 C3}
Ci
t
-1
+4
+3
+2
+1
0
-1
-2
-3
-4
{C0 C1 C2 C3}
Si
{C0 C1 C2 C3}
S3
U1
Tc
S0
S1
U0
S2
Tb
chantillonnage
Di = Di
+1
t
-1
Questions :
a. Essayez de reconstituer le signal Sj et le signal Di.
b. Comparer Di avec Di. Quel est le retard entre les deux ? Pourquoi ?
Rponse :
Fonctionnement du rcepteur
1Tc
Dcalage
Tc
Mk
2Tc
-1 -1 -1
REG1
-1 1
Mk
-1 -1
REG1
S0=0
S1=0
Chargement 1 1 -1 1
Tb
C3 C2 C1 C0
-1 1
-1 1
C3 C2 C1 C0
3Tc
Mk
REG1
-1
REG1
-1 1
S3=4
S2=-2
1
-1 1
C3 C2 C1 C0
C3 C2 C1 C0
5Tc
Mk
-1
-1 1
6Tc
REG1
Mk
-1 1
REG1
S4=2
S5=-2
-1 1
-1
C3 C2 C1 C0
7Tc
1
-1 1
Mk
-1 1
-1 1
S6=2
REG1
S7=-4
1
-1 1
-1
C3 C2 C1 C0
S j M j i Ci
i 0
Mj+i
Dcalage
Tc
Fig. 2
Di
Circuit de
dcision
(comparateur)
Mmoire
Ci
Remise Zro
de la mmoire
Echantillonnage
Tb
Remarques :
.1. Le systme demande une synchronisation trs prcise en frquence et en
phase (connaissance exacte de Tc et Tb). La gnration du code Ci dans le
rcepteur doit tre exactement synchrone avec le code dans lmetteur.
.2. Il est possible dinverser la place de lchantillonneur et du comparateur.
Question :
Montrer que la structure de la Fig. 1 et celle de la Fig.2 sont quivalentes.
Remarque : Il suffit de refaire les questions a. et b.