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ISET KSAR HELLAL Dpartement GM
INTRODUCTION
Ces travaux pratiques dlectronique sont lintention des tudiants
de deuxime anne gnie mcanique de l'Institut Suprieur des tudes
Technologiques de Ksar-Hellal.
Le fascicule comporte 3 TP :
TP 1 : Etude des oprateurs logiques.
TP 2 : Dcodeurs, Multiplexeur, comparateur et additionneur .
TP3 : La logique squentielle.
Dans
ce
TP
vous
allez
apprendre
utiliser
les
portes
logiques
lectronique.
Comment raliser un logigramme rel en utilisant des portes
logiques lectroniques.
Comment sont reprsents le 0 logique et le 1 logique dans un
montage lectronique.
Ce que vous devez faire avant de commencer le TP :
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On peut remarquer sur le haut des circuit intgr un petit creux appel
ergo . Lergo permet dorienter correctement le circuit intgr afin de
reprer les difrentes bornes.
Un circuit intgr renferme plusieurs portes logiques, dont les entres et
les sorties sont accessibles sur les difrentes bornes du circuit intgr.
Pour identifier chaque borne sans ambigut, elles sont numrotes de
manire normalise en respectant le principe suivant :
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TP 1 :
Etude des oprateurs logiques
I. But de la manipulation:
Le but de ce TP est dtudier les proprits des diffrents oprateurs
logiques.
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2. Logique
fonctions
Les fonctions de base
lalgbre de Boole sont
A
1
0
1
0
1
0
1
0
B
1
1
0
0
1
1
0
0
C
1
1
1
0
1
0
0
0
S
1
0
0
0
0
0
0
0
combinatoire et
fondamentales:
de la logique et de
le ET (AND), le OU
Symbol
e
NON / NOT
Equatio
n
logique
s=a
Table de
vrit
0
1
7407
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OU / OR
s=ab
ET / AND
74LS32N
Les
portes
NON-ET
(NAND)
et
NON-OU
(NOR)
sont
qualifies
Symbol
e
Equatio
n
logiqu
s=
Table
de
vrit
a
b
S
NON-OU /
NOR
74LS02N
NON-ET /
s=
NAND
74LS00B1
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Symbol
e
Equatio
n
logique
s=
/ XOR
Table
de
vrit
a b
S
a
74LS86AN
2.6.
Circuit
logique
simple:
Soit les logigrammes suivants:
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CITERNE A LAIT
A. Prparation de lexprimentation.
1.
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P1 et P2 en
marche
P1 en marche
P1 et P2 larrt
Dfaut de
fonctionnement
P1 et P2 larrt
1.
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CIRCUITS LOGIQUES COMBINATOIRES &
2.
A partir du cahier des charges
du systme dresser la table de vrit
SEQUENTIELS
3.
4.
oprations boolennes.
5.
6.
7.
le
schma
structurel
aux
normes
correspondant
B. Exprimentation.
8.
9.
10.
appliques
sur
sur
entres
e3 e2
e3 e2
logique
les entres
e1
Etat
sortie P1
e1
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TP 2 :
Dcodeur, Multiplexeur,
comparateur et additionneur
I. But de la manipulation:
L'objectif de ce TP est
1. Dcodeurs:
n
Un dcodeur est un circuit qui possde n entres et 2 sorties. Pour chacune des
combinaisons binaire prsente sur les lignes de slection(ou lignes d'adresses)
il force une parmi les lignes de la sortie au niveau haut.
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Dcode
ur
n entres
2 sorties
2. Multiplexeurs:
Le
multiplexage
consiste
envoyer
sur
une
mme
ligne
de
Multiplexage de donnes
C'est un circuit 2
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la
informatiques
de
transmission
de
donnes
lorsque
les
systmes
lon
souhaite
exemple,
dans
un
multiplexeur
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reprsent
la figure
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Variables dentre :
d
Affichage
segments
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4.
Comparateur:
Avec :
A0 A1 les entres reprsentant le premier nombre (N1).
B0 B1 les entres reprsentant le second nombre (N2).
Y la sortie .
Etablir la table de karnaugh d'un comparateur B>A, dans le cas de
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4.
bits
Raliser les fonctions et CN l'aide des difrents circuits
disponibles
Vrifier le bon
fonctionnement
du
montage
en
utilisant
les
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