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Microprocesseur
PowerPC 750
Guillaume Rinc
X96 2me Cie
I Lvolution du PowerPC
Les processeurs PowerPC sont apparus en 1993. Ils sont dvelopps par IBM et par
Motorola sous licence IBM. Auparavant, les processeurs des ordinateurs grand public taient
tous de type CISC, que ce soient ceux dIntel pour le monde PC ou ceux de Motorola pour le
monde Apple. Le PowerPC 601 est le premier processeur RISC tourner dans un ordinateur
de ce type, il vient remplacer la fameuse famille des 68000 qui tournait au c ur des premiers
Macintosh.
Lvolution de la famille PowerPC va se faire ensuite en troite collaboration entre
IBM, Motorola et Apple. Actuellement, le PowerPC 750 ou PowerPC G3 est la dernire
volution fruit de cette collaboration.
II Analyse
processeur
du
diagramme
de
fonctionnement
du
Rename Buffers . Les rsultats sont stocks dans le Rename Buffer et sont ainsi
accessibles aux instructions suivantes.
La FPU est forme dun multiplicateur / additionneur de prcision simple et dun
registre de contrle de ltat de lunit ( Floating-Point Status and Control Register FPSCR).
A chaque cycle dhorloge, la LSU peut accder deux mots de la cache de donnes.
Lors dun renouvellement, la LSU est bloque pour un cycle dhorloge pour que le bloc de
huit mots puisse tre copi.
Suivant sa taille, la cache L2 est organise en lignes de 64 ou 128 bytes qui sont
divises en blocs de 32 bytes. Le contrleur de la cache L2 dispose dun registre L2 Cache
Control Register (L2CR) qui permet de dfinir le ratio frquence du bus ddi la cache L2
sur frquence du processeur, didentifier le type de RAM utilis pour la cache L2,
Les requtes de la cache L1 sont principalement des instructions ou des chargements /
stockages de donnes. Si la cache L2 peut rpondre, elle le fait, sinon, elle oriente la requte
vers le bus interface o se trouve la rponse la requte.
1. Adress Arbitration : ces signaux sont utiliss pour grer la proprit du bus
dadresses
2. Adress start : ces signaux signifient quun propritaire du bus a commenc une
transaction
3. Adress transfer : ces signaux sont utiliss pour transfrer une adresse et pour
sassurer du succs du transfert
4. Transfer attribute : ces signaux donnent des informations sur le type de
transfert, comme la taille du transfert, le mode de transfert
5. Adress termination : ces signaux sont utiliss pour indiquer la fin de la phase
adresse dune transaction ou bien pour dire que la phase adresse doit tre rpter.
6. Data arbitration : ces signaux sont utiliss pour grer la proprit du bus de
donnes
7. Data transfer : ces signaux sont utiliss pour transfrer les donnes adresse et
pour sassurer du succs du transfert
8. Data termination : ces signaux marquent la fin de chaque transfert de donnes
9. L2 cache clock / control : ces signaux permettent le contrle de lhorloge de la
cache L2
10. L2 cache adress/data : le 750 a un bus dadresses et un bus de donnes spares
11. Interrupt : ces signaux comprennent :
1. Interrupt
2. Checkstop
3. Soft Reset
4. Hard Reset
Ces signaux sont utiliss afin de faire un reset du processeur
Processor status / control : ces signaux sont utiliss pour grer et contrler le
processeur
Clock signals : ces signaux dterminent la frquence dhorloge du processeur
et peuvent aussi servir synchroniser un systme multiprocesseur
Les dtails des signaux du PowerPC 750 sont indiqus sur le schma suivant.
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II.9 Lhorloge
Le 750 possde une unique entre pour le signal dhorloge, SYSCLK, qui reprsente
la frquence du bus interface. A lintrieur du processeur, un circuit gnre une autre horloge
multiplie en frquence, mais en phase avec SYSCLK. Cette frquence est utilise pour les
oprations internes au processeur.
Le signal PLL_CFG[0-3] permet de dfinir le rapport entre frquence du bus et
frquence du processeur.
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Le tableau suivant donne la liste complte des exceptions du PowerPC 750 ainsi que
les causes de ces exceptions.
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Le PowerPC 750 met en uvre cette architecture en dissociant les instructions des
donnes.
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Cette unit surveille et rgule la temprature. Par exemple, si la temprature est sur le
point de dpasser un seuil critique, le systme ralentit ou suspend temporairement les
excutions afin de faire baisser cette temprature.
La TAU se compose entre autres dun capteur de temprature interne, dun
convertisseur numrique analogique, dun comparateur. Elle compare la temprature de
jonction avec les rglages de lutilisateur, elle gnre des interruptions lorsque la temprature
ne correspond plus aux rglages et elle permet lutilisateur destimer la temprature de
jonction via des routines appropries.
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Bibliographie
1. PowerPC 750 SCM RISC Microprocessor Datasheet version 3.1 IBM - 1998
2. PowerPC 750 RISC Microprocessor Users Manual IBM 1997
3. PowerPC 750 Microprocessor High Performance, Low Power Consumption IBM
1998
4. Motorola PowerPC 750 and PowerPC 740 Microprocessors Fact Sheet Motorola 1999
5. Site web IBM : http://www.chips.ibm.com
6. Site web Motorola : http://www.mot.com
7. Site web Apple : http://www.apple.com
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