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FUNDACIÓN UNIVERSITARIA KONRAD LORENZ-INGENIERÍA DE
SISTEMAS
Por lo tanto se obtiene para B4 la siguiente expresión:
B4 = A3A2 + A3A1 = A3(A2 + A1)
El resultado de esta implementación se llevara a las entradas B 3 y
B2 del sumador con el fin de obtener el resultado deseado.
Nota:Es necesario recordar que en la anterior descripción no tiene
significado el hecho de no tener una secuencia consecutiva de valores. Así mismo en los valores
de las entradas A serán ubicados los valores de salida de cada FF.
“Decodificación” y presentación del resultado.
Cada una de las salidas del sumador deben ser las entradas del
decodificador/manejador que en este caso es el circuito 7447. A su vez este
circuito arroja las salidas a, b, c, d, e, f yg a nivel bajo que representan los siete
(7) segmentos de un Display y específicamente uno de ánodo común. El
Display utilizado es de la serie 5161 que tiene la siguiente distribución:
FUNDACIÓN UNIVERSITARIA KONRAD LORENZ-INGENIERÍA DE
SISTEMAS
Simulación.
Para llevar a cabo la simulación de la implementación del circuito se utilizó
la herramienta Circuit Maker 2000. Anexo al archivo de este documento se
encuentra un archivo llamado Práctica_8.ckt en el cual se encuentra el
modelo del circuito completo. Sin embargo a continuación se muestra el
dibujo del circuito obtenido de este software.
FUNDACIÓN UNIVERSITARIA KONRAD LORENZ-INGENIERÍA DE
SISTEMAS

FUNDACIÓN UNIVERSITARIA KONRAD LORENZ-INGENIERÍA DE

SISTEMAS
CONCLUSIONES
Este laboratorio presentó como retos principal la realización del análisis de
las salidas deseadas para obtener el diseño del circuito que permita
visualizar los resultados esperados.
En primera instancia se realizó el análisis de la secuencia de números
asignada y se obtuvieron las expresiones necesarias para llevar a cabo la
implementación del contador en código binario. Luego se implementó un
circuito que ya era conocido como lo es el conversor de código binario a
BCD y por último se realizó una actividad conocida como es la
decodificación y posterior visualización en Displays de siete segmentos.
En la realización de la simulación se pudo ratificar que los tiempos de retardo
en la propagación de datos entre un FF y otro que se presentaban en la
implementación asíncrona se vieron disminuidos y que éstos no se
presentaban en secuencias de 30ns por cada FF sino que el retraso de 30ns
ocurre una vez en cada cambio de estado.
Con este circuito fue posible desarrollar cierta habilidad a la hora de
plantear soluciones mediante el diseño y permitió reforzar los conceptos
vistos en clase.
Por último, fue de gran importancia conocer los comportamientos de los
circuitos utilizados para obtener una implementación exitosa respecto al
diseño realizado previamente.

Diseño de contador síncrono

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ingenieria de sistemas
CONTADOR SINCRONO
ELEMENTOS DE COMPUTADOR
secuencia binaria
sincrono secuencia
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