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Vref
Enatrada Binaria
Vout
DAC
Wilfredo Bermdez
Daniel Mera
Jorge Manrique
Luis A. Rocca
Carlos Bula
Salida
Analgica
AGENDA
INTRODUCCION
MARCO TEORICO
APLICACIONES
DAC
SWITCHES
OPAM
RED RESISTIVA
CONCLUSIONES
Introduccin
La conversin DAC es el proceso de tomar un valor representado en cdigo
digital y convertirlo en un voltaje o corriente que sea proporcional al valor
suministrado. La aplicacin principal de este tipo de dispositivos est dada en
sistemas electrnicos tales como amplificadores, control de motores,
calefactores, etc.
Para el diseo del DAC se utiliz el esquema en escalera R-2R con algunos
ajustes que permitieron mejorar su comportamiento y obtener mayor exactitud
de los valores digitales ponderados a la salida.
Marco Terico
Arquitecturas principales de los DACs :
R-2R (Escalera de resistencias)
String
Resistores de ponderacin binaria
Arquitectura Escogida
To OPAMP
R-2R Ladder
(b0 20 b1 21 b2 2 2 b3 23 ...bn 1 2 n 1 )
Vout Vref
2N
Aplicaciones
En instrumentacin y control automtico: Son la base para implementar
DAC (Esquematico)
DAC (Symbol)
DAC (Prueba)
DAC (Extracted)
DAC (Matching 1)
DAC (Matching 2)
Rdsn=300 Ohms
Rdsp=291 Ohms
Rds= Rdsn // Rdsp = 149
SWITCHES (Esquematico
1)
SWITCHES (Esquematico
2)
SWITCHES (Symbol)
SWITCHES (Inversor-Esquematico)
SWITCHES (InversorSymbol)
SWITCHES (Inversor-Simulacion)
SWITCHES (InversorLayout)
SWITCHES (InversorExtracted)
SWITCHES (Inversor-Matching 1)
SWITCHES (Inversor-Matching 2)
SWITCHES (Layout)
SWITCHES (Extracted)
SWITCHES (Matching 1)
SWITCHES (Matching 2)
Asunciones
Se asumi una corriente de polarizacin de 100uA para el par
diferencial.
Para la Etapa de salida una corriente de 150uA
La ganancia de cada etapa es de 45V/V \Aprox
Av1
2gm N 2
I D N 7 ( N P )
g mP 4
Av 2
I DN 18 ( N P )
realimentacin Cc.
Se coloca adicionalmente un resistor Rz para compensar la
fase.
Se compenso el amplificador en open loop para que cruzara
0dB a 3.75MHz y con un margen de fase de 60 grados.
Los valores requeridos: Cc=15pF y Rz=500 Ohms
OPAM (Esquematico)
OPAM (Symbol)
F0dB=3.75M
Hz
PM=60
deg
Vmin=0.8V
OPAM (Respuesta a
Senoidal)
SR=6.4V/
uS
El slew rate del Opam se calculo mediante una simulaciones
spectre.
El slew rate con la Capacitancia de carga de 20pF resulto de
6.4V/uS.
OPAM (Layout 1)
OPAM (Layout 2)
OPAM (Extracted 1)
OPAM (Extracted 2)
OPAM (Matching 1)
OPAM (Matching 2)
R-2R (Esquematico)
R-2R (Symbol)
R-2R (Layout)
R-2R (Extracted)
R-2R (Matching 1)
R-2R (Matching 2)
Ventajas y desventajas
Ventajas
Alta velocidad de operacin, hasta 3.75MHz
Alta exactitud
Low Power
Desventajas
Rango de Voltajes de referencia limitado
Conclusiones
En el diseo del DAC el tamao de los switches
Referencias
Sedra A. and Smith K., Microelectronics Circuits,
ence_tutorial.htm
http://www.eng.utah.edu/~bowen/DAC_Proj/8bit_r2rdac_current_sources.html
Preguntas